Benutzeranleitung / Produktwartung CY7C1482V25 des Produzenten Cypress
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72-Mbit (2M x 36 /4M x 18/1M x 72) Pipelined Sync SRAM CY7C1480V25 CY7C1482V25 CY7C1486V25 Cypress Semiconductor Corpora tion • 198 Champion Court • San J ose , CA 95134-1709 • 408-943-2600 Document #: 38-05282 Rev .
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 2 of 32 Logic Block Diagram – CY7C1480V25 (2 M x 36) Logic Block Diagram – CY7C1482V25 (4 M x 18) ADDRESS REGISTER ADV CLK BU.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 3 of 32 Logic Block Diagram – CY7C1486V25 (1 M x 72) BW D BW C BW B BW A BWE GW CE1 CE2 CE3 OE ENABLE REGISTER PIPELINED ENABLE.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 4 of 32 Pin Configurations 100-Pin TQFP Pinout DQP B DQ B DQ B V DDQ V SSQ DQ B DQ B DQ B DQ B V SSQ V DDQ DQ B DQ B V SS NC V DD.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 5 of 32 Pin Configurations (continued) 165-Ball FBGA (15 x 17 x 1.4 mm) Pinout CY7C1480V25 (2M x 36) CY7C1482V25 (4M x 18) 234 5 .
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 6 of 32 Pin Configurations (continued) CY7C1486V25 (1M × 72) 209-Ball FBGA (14 x 22 x 1.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 7 of 32 Pin Definitions Pin Name I/O Description A 0 , A 1 , A Input- Synchronous Address Inputs used to select one of the address locatio ns . Sampled at the rising edge of the CLK if ADSP or ADSC is active LOW , and CE 1 , CE 2 , and CE 3 are sampled active.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 8 of 32 Functional Overview All synchronous inputs pass through input registers controlled by the rising edge of the clock. All data outputs pass through output registers controlled by the rising edge of the clock.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 9 of 32 DQs are automatically tri-stat ed whenever a write cycle is detected, regardless of the state of OE .
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 10 of 32 Notes 3. X = “Don't Care.” H = Logic HIGH, L = Logic LOW . 4. WRITE = L when any one or more Byte Write Enab le signals and BWE = L or GW = L. WRITE = H when all Byte Write Enable signals, BWE , GW = H.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 1 1 of 32 T ruth T able for Read/Write The read/write truth table for the CY7C1480V25 follows.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 12 of 32 IEEE 1 149.1 Serial Boundary Scan (JT AG) The CY7C1480V25/CY7C148 2V25/CY7C1486V25 incorpo- rates a serial boundary scan test access port (T AP). This port operates in accordance with IEEE S tandard 1 149.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 13 of 32 Instruction Register Three-bit instructions can be serially loaded into the instruction register . This register is loaded w hen it is placed betwe en the TDI and TDO balls as shown in the “T AP Controller Block Diagram” on page 12 .
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 14 of 32 The SRAM clock input might no t be captured correctly if there is no way in a design to stop (or slow) the clock during a SAMPLE/PRELOAD instruction.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 15 of 32 2.5V T AP AC T est Conditions Input pulse levels ...... .............. ............ .............. .. V SS to 2.5V Input rise and fall time ........... ........... .......
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 16 of 32 Scan Register Sizes Register Name Bit Size (x36) Bit Size (x18) Bit Size (x72) Instruction 3 3 3 Bypass 1 1 1 ID 32 32 3.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 17 of 32 Boundary Scan Exit Order (4M x 18) Bit # 165-Ball ID Bit # 165-Ba ll ID Bit # 165-Ball ID 1D 2 1 9 R 8 3 7 C 1 1 2E 2 2 .
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 18 of 32 Boundary Scan Exit Order (1M x 72) Bit # 209-Ball ID Bit # 209-Ball ID Bit # 209-Ball ID Bit # 209-Ball ID 1 A1 29 T 1 5.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 19 of 32 Maximum Ratings Exceeding the maximum rati ngs may impair the useful life of the device. The se user guid elines are no t tested. S torage T emperature .. .............. .
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 20 of 32 Cap acit ance [14] Parameter Description T est Conditions 100 TQFP Package 165 FBGA Package 209 FBGA Package Unit C ADDRESS Address Input Capa citance T A = 25 ° C, f = 1 MHz, V DD = 2.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 21 of 32 Notes 15. T iming reference level is 1.25V when V DDQ = 2.5V and is 0.9V w hen V DD Q = 1.8V . 16. T est conditions shown in (a) of “AC T est Loads and W aveforms” on pa ge 20 unless otherwise not ed.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 22 of 32 Switching W aveforms Read Cycle Timing [21] t CYC t CL CLK ADSP t ADH t ADS ADDRESS t CH OE ADSC CE t AH t AS A1 t CEH t CES GW, BWE, BWx D ata Out (Q) High-Z t CLZ t DOH t CO ADV t OEHZ t CO Single READ BURST READ t OEV t OELZ t CHZ ADV suspends burst.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 23 of 32 Write Cycle T iming [21, 22] Switching W aveforms (continued) t CYC t CL CLK ADSP t ADH t ADS ADDRESS t CH OE ADSC CE t .
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 24 of 32 Read/Write Cycle Timing [21, 23, 24 ] Switching W aveforms (continued) t CYC t CL CLK ADSP t ADH t ADS ADDRESS t CH OE A.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 25 of 32 ZZ Mode T iming [25, 26] Switching W aveforms (continued) t ZZ I SUPPLY CLK ZZ t ZZREC A LL INPUTS (except ZZ) DON’T CARE I DDZZ t ZZI t RZZI Outputs (Q) High-Z DESELECT or READ Only Notes 25.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 26 of 32 Ordering Information Not all of the speed, package and temperature ranges are available. Please co ntact your local sales represe ntative or visit www .cypress .com for a ctual prod ucts offered.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 27 of 32 250 CY7C1480 V25-250AXC 51-85050 100-Pin Thin Quad F lat Pack (14 x 20 x 1.4 mm) Lead-Free Commercia l CY7C1482V25-250AXC CY7C1480V25-250BZC 51-85165 165-ball Fine-Pitc h Ball Grid Array (15 x 17 x 1.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 28 of 32 Package Diagrams Figure 1. 100-Pin Thin Plastic Quad Fl atpack (14 x 20 x 1.4 mm), 51-8 5050 NOTE: 1. JEDEC STD REF MS-026 2. BODY LENGTH DIMENSION DOES NOT INCLUDE MOLD PROTRUSION/END FLASH MOLD PROTRUSION/END FLASH SHALL NOT EXCEED 0.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 29 of 32 Figure 2. 165-Ball FBGA (15 x 17 x 1.4 mm), 51-85165 Package Diagrams (continued) A 1 PIN 1 CORNER 17.00±0.10 15.00±0.10 7.00 1.00 Ø0.45±0.05(165X) Ø0.25 M C A B Ø0.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 30 of 32 © Cypress Semico nductor Corpor ation, 2002- 2007. The inform ation contai ned herein is sub ject to change wi thout notice.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 31 of 32 Document History Page Document Title: CY7C1480V25/CY7C1482V25 /CY7C1486V25 72 -Mbit (2M x 36/4M x 18/1M x 72) Pipelined Sy nc SRAM Document Number: 38-05282 REV . ECN NO. Issue Date Orig.
CY7C1480V25 CY7C1482V25 CY7C1486V25 Document #: 38-05282 Rev . *H Page 32 of 32 *G 4866 90 See ECN VKN Corrected the typo in the 209-Ball FBGA pinout. (Corrected the ball name H9 to V SS from V SSQ ).
Ein wichtiger Punkt beim Kauf des Geräts Cypress CY7C1482V25 (oder sogar vor seinem Kauf) ist das durchlesen seiner Bedienungsanleitung. Dies sollten wir wegen ein paar einfacher Gründe machen:
Wenn Sie Cypress CY7C1482V25 noch nicht gekauft haben, ist jetzt ein guter Moment, um sich mit den grundliegenden Daten des Produkts bekannt zu machen. Schauen Sie zuerst die ersten Seiten der Anleitung durch, die Sie oben finden. Dort finden Sie die wichtigsten technischen Daten für Cypress CY7C1482V25 - auf diese Weise prüfen Sie, ob das Gerät Ihren Wünschen entspricht. Wenn Sie tiefer in die Benutzeranleitung von Cypress CY7C1482V25 reinschauen, lernen Sie alle zugänglichen Produktfunktionen kennen, sowie erhalten Informationen über die Nutzung. Die Informationen, die Sie über Cypress CY7C1482V25 erhalten, werden Ihnen bestimmt bei der Kaufentscheidung helfen.
Wenn Sie aber schon Cypress CY7C1482V25 besitzen, und noch keine Gelegenheit dazu hatten, die Bedienungsanleitung zu lesen, sollten Sie es aufgrund der oben beschriebenen Gründe machen. Sie erfahren dann, ob Sie die zugänglichen Funktionen richtig genutzt haben, aber auch, ob Sie keine Fehler begangen haben, die den Nutzungszeitraum von Cypress CY7C1482V25 verkürzen könnten.
Jedoch ist die eine der wichtigsten Rollen, die eine Bedienungsanleitung für den Nutzer spielt, die Hilfe bei der Lösung von Problemen mit Cypress CY7C1482V25. Sie finden dort fast immer Troubleshooting, also die am häufigsten auftauchenden Störungen und Mängel bei Cypress CY7C1482V25 gemeinsam mit Hinweisen bezüglich der Arten ihrer Lösung. Sogar wenn es Ihnen nicht gelingen sollte das Problem alleine zu bewältigen, die Anleitung zeigt Ihnen die weitere Vorgehensweise – den Kontakt zur Kundenberatung oder dem naheliegenden Service.
